SoC Blockset では、プログラム可能な SoC や ASIC 上でのアルゴリズムのパフォーマンスをシミュレーションし、解析できます。これらのアルゴリズムをハードウェアおよびソフトウェアのアプリケーションとして展開し、プロトタイピングや量産を行うことができます。
このブロックセットを使用すると、プロセッサコア、プログラム可能なロジック、メモリ、および周辺機器間のインターフェイスを定義することにより、ハードウェア アーキテクチャのモデルを構築できます。このモデルを使用して、プログラム可能なロジックとプロセッサの間でアルゴリズムを分割し、ハードウェアとソフトウェア実装間のトレードオフを解析できます。また、このブロックセットでは、ソフトウェア アプリケーションのタスク スケジューリングを指定できます。
SoC Builder アプリは、Simulink からの Arm® コア用の IP コアおよびソフトウェアの構築と、開発ボードのプログラミングにより展開を自動化します (HDL Coder および Embedded Coder を使用)。
SoC Blockset は、パフォーマンス診断やソフトウェア プロファイリング ツールを使用して、ハードウェアに展開されたアプリケーションの解析をサポートします。サポート対象デバイスには、AMD® Zynq®-7000 SoC、Zynq UltraScale+ MPSoC/RFSoC、Versal™ アダプティブ SoC、および Intel® SoC FPGA があります。
仕様からのアーキテクチャ
選択したハードウェアでアプリケーションのソフトウェアタスクをスケジュールできるかどうかを判断するために、設計の予備的解析を行います。System Composer でアプリケーションの機能アーキテクチャから開始し、機能コンポーネントをプロセッサやプログラム可能なロジックに割り当てます。
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Versal、Zynq RFSoC/MPSoC をターゲット化
最新のプログラム可能な AMD SoC デバイスの事前定義済みモデルを使用してシステム設計を解析し、SoC Builder ツールを使用してテスト用の開発ボードに展開します。
ドキュメンテーション (Versal、RFSoC/MPSoC)
例 (Versal、RFSoC/MPSoC)
RFSoC デバイス上の 5G アプリケーション
Wireless HDL Toolbox を使用し、AMD Zynq UltraScale+ RFSoC ボードをターゲットとした SoC Blockset 実装を用いて、5G NR MIB リカバリアルゴリズムまたは FR1 および FR2 用の 5G NR SIB1 リカバリアルゴリズムをシミュレーションおよび展開します。
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アルゴリズムのリソース使用の解析
Simulink モデルまたは MATLAB アルゴリズムを解析して、実装に必要な算術演算子の数を要約したレポートを生成します。これらのレポートを使用して、FPGA、ASIC、SoC デバイスのさまざまなアーキテクチャを比較し、設計上のトレードオフを評価して、ハードウェアとソフトウェアの分割オプションを探索します。
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DDR メモリのモデル化
DDR メモリをモデル化して、ハードウェアロジックと組み込みプロセッサ間で共有メモリのトランザクションをシミュレーションします。メモリトラフィックを調停するよう、DMA コントローラーを構成します。シミュレーションでメモリレイテンシとスループットを考慮します。
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タスク実行の解析
オペレーティングシステム (OS) で管理されているとおり、組み込みソフトウェアのタスク実行をモデル化します。コンテキストの切り替え、タスクのプリエンプション、および実行期間を考慮し、正確なタイミングでタスクをシミュレーションします。FPGA ファブリックで生成されたソフトウェア割り込みをモデル化します。統計を適用して非確定的なタスク期間をシミュレーションするか、またはハードウェアテスト中に測定されたタスクの期間を取り込みます。
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HDL Coder リファレンス設計の生成
SoC Blockset モデルから HDL Coder リファレンス設計を直接生成し、HDL ワークフロー アドバイザー ツールを使用して HDL Coder で作成した IP コアを統合します。
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COTS ボードとカスタムボードをターゲット化
OS カスタマイザーツールを使用して、組み込みプロセッサ用にライブラリを変更して Linux® ディストリビューションに追加します。サポートされているボードの組み込み Linux オペレーティング システムをカスタマイズします。
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